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“FPGA開發(fā)中Vivado生成bit文件遇到的錯(cuò)誤解決方案“

2年前作者：心之向往！分類：Toy博客閱讀(32)違法舉報(bào)

這篇具有很好參考價(jià)值的文章主要介紹了“FPGA開發(fā)中Vivado生成bit文件遇到的錯(cuò)誤解決方案“。希望對(duì)大家有所幫助。如果存在錯(cuò)誤或未考慮完全的地方，請(qǐng)大家不吝賜教，您也可以點(diǎn)擊"舉報(bào)違法"按鈕提交疑問。

“FPGA開發(fā)中Vivado生成bit文件遇到的錯(cuò)誤解決方案”

FPGA開發(fā)是現(xiàn)在工業(yè)界中越來越廣泛使用的技術(shù)，但是在開發(fā)過程中難免會(huì)出現(xiàn)一些問題。其中，Vivado生成bit文件報(bào)錯(cuò)是一個(gè)比較常見的問題。下面，我將詳細(xì)介紹這個(gè)問題以及如何徹底解決。

一、問題描述

當(dāng)我們進(jìn)行FPGA項(xiàng)目開發(fā)，使用Vivado軟件生成bit文件時(shí)，可能會(huì)遇到以下類似的錯(cuò)誤：

ERROR: [Common 17-69] Command failed: This design contains one or more cells for which bitstream generation is not permitted:
    top_module/u1/u2/u3/reg_filter

這個(gè)錯(cuò)誤的意思是，Vivado無法生成特定單元的bit文件。通常，這種問題的根源是Vivado在生成bit文件時(shí)需要訪問未批準(zhǔn)的IP核，從而導(dǎo)致錯(cuò)誤的發(fā)生。

二、錯(cuò)誤原因

我們可以通過搜索錯(cuò)誤信息，找到以下解釋：

“在生成比特流時(shí)，當(dāng)vivado生成器遇到具有引腳鎖定的信號(hào)調(diào)節(jié)器實(shí)例時(shí)，此錯(cuò)誤會(huì)被顯示。信號(hào)調(diào)節(jié)器實(shí)例可能不允許比特流生成，因?yàn)橛幸粋€(gè)或多個(gè)未批準(zhǔn)的ip核?！?/p>

簡(jiǎn)單來說，我們?cè)陧?xiàng)目中使用了未批準(zhǔn)的IP核。這些IP核可以是第三方的IP核或自己編寫的IP核，但是沒有在項(xiàng)目中進(jìn)行正確的添加和授權(quán)。

三、解決方案

針對(duì)這種錯(cuò)誤，我們可以采取以下解決方案：

授權(quán)IP核

首先要做的事情是確保每個(gè)使用的IP核都已經(jīng)獲得了授權(quán)。如果IP核不是您自己編寫的，通?？梢郧巴?yīng)商網(wǎng)站上查找它們的授權(quán)信息。如果是您自己編寫的IP核，則需要正確地添加到項(xiàng)目中并確保其已被文章來源地址http://www.zghlxwxcb.cn/news/detail-760437.html

到了這里，關(guān)于“FPGA開發(fā)中Vivado生成bit文件遇到的錯(cuò)誤解決方案“的文章就介紹完了。如果您還想了解更多內(nèi)容，請(qǐng)?jiān)谟疑辖撬阉鱐OY模板網(wǎng)以前的文章或繼續(xù)瀏覽下面的相關(guān)文章，希望大家以后多多支持TOY模板網(wǎng)！

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