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文章來源地址http://www.zghlxwxcb.cn/news/detail-624006.html
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? 本次項目是在https://github.com/yfshich/wdcnn_bearning_fault_diagnosis-master 開源項目基礎(chǔ)上做的迭代曲線和混淆矩陣和特征可視化? 1項目文件 data文件夾裝載的是凱斯西楚大學（CWRU）軸承數(shù)據(jù)集 以0HP文件夾為例，進行展示 main_0HP.py、main_1HP.py、main_2HP.py和main_3HP.py是故障診斷主程序，分
展示了如何將LabVIEW開發(fā)出一種有效的滾動軸承故障在線監(jiān)測系統(tǒng)。介紹了該系統(tǒng)的開發(fā)過程、工作原理及其在實際應用中的效果。該系統(tǒng)成功地應用于對滾動軸承故障的早期診斷，提高了故障檢測的準確性和效率。 滾動軸承在工作過程中會產(chǎn)生復雜的振動信號，包括非周期
完整的伺服系統(tǒng)所包含的模塊比較多，因此無法逐一詳細介紹，所以本章著重介紹 設(shè)計難度較高的 FPGA 部分并簡單介紹 ARM 端的工作流程。 FPGA 部分主要有 FOC 算法、電流采樣算法及編碼器采樣算法，是整個控制系統(tǒng)的基礎(chǔ)，直接決定電機控制 效果的好壞。因為 FPGA 工作的特
設(shè)計需求 一套完整的伺服控制方案包括了上位機、驅(qū)控一體控制器和功率板三者。操作人員 通過上位機發(fā)送各種不同指令，然后控制器解析指令后執(zhí)行相應的伺服功能，其次控 制器將驅(qū)動信號傳輸至功率板驅(qū)動電機，最后控制器采集反饋信息進行閉環(huán)控制并上 傳數(shù)據(jù)。 結(jié)
本部分主要介紹 FPGA+ARM 控制部分的軟件設(shè)計。 FPGA+ARM 控制部分包括 Verilog HDL 硬件描述語言和 C 語言的開發(fā)。 FPGA 部分主要控制 AD7606 模數(shù)轉(zhuǎn)換、數(shù)字三相鎖相 環(huán)和FFT諧波計算模塊、 SDRAM 控制器的設(shè)計、 FSMC 接口模塊等。 ARM 部分主要完成嵌 入式實時操作系統(tǒng) FreeRTOS 的移植
本章主要給出了本系統(tǒng)的設(shè)計目標和硬件設(shè)計方案，后面詳細介紹了硬件電路的設(shè)計 過程，包括數(shù)據(jù)采集板、 FPGA+ARM 控制板。 3.1系統(tǒng)設(shè)計目標 本系統(tǒng)的主要目的是實現(xiàn)電能質(zhì)量指標的高精度測量和數(shù)據(jù)分析，其具體技術(shù)指標如 下所示： 1.電能質(zhì)量指標測量精度： (1) 電壓：
針對在軟體機器人控制時 ， 多電機協(xié)同控制過程中難度大 、 通用性差 、 協(xié)同性差等缺點 ， 設(shè)計了基于 AＲM 和 FPGA 的軟體機器人的控制器局域網(wǎng)絡 ( controller area network ， CAN ) 總線運動控制器 ， 采用 AＲMCortex-M4 為內(nèi)核的 STM32F407 開發(fā)板和 AX7102 FPGA 開發(fā)板設(shè)計一種基于 C
SPI通信協(xié)議有以下4種模式： 模式0：時鐘極性為0，時鐘相位為0，數(shù)據(jù)在時鐘下降沿捕獲，數(shù)據(jù)在時鐘上升沿改變。 模式1：時鐘極性為0，時鐘相位為1，數(shù)據(jù)在時鐘上升沿捕獲，數(shù)據(jù)在時鐘下降沿改變。 模式2：時鐘極性為1，時鐘相位為0，數(shù)據(jù)在時鐘上升沿捕獲，數(shù)據(jù)在時鐘
運動控制器是數(shù)控機床 、 高端機器人等自動化設(shè)備控制系統(tǒng)的核心 。 為保證控制器的實用性 、 實時性和穩(wěn)定 性， 提出一種以 STM32 為主控制器 、 FPGA 為輔助控制器的多軸運動控制器設(shè)計方案 。 給出了運動控制器的硬件電路設(shè)計 ， 將 S 形加減速算法融入運動控制器 ，
數(shù)據(jù)采集系統(tǒng)在現(xiàn)代工程中起著至關(guān)重要的作用，用于實時獲取和處理各種傳感器或外部設(shè)備的數(shù)據(jù)。在本文中，我們將探討如何基于STM32微控制器和FPGA（現(xiàn)場可編程門陣列）實現(xiàn)一個高效的數(shù)據(jù)采集系統(tǒng)。我們將詳細介紹系統(tǒng)設(shè)計的關(guān)鍵步驟，并提供相應的源代碼示例。
