一.存儲(chǔ)器的性能指標(biāo)
1.MAR是地址寄存器，MDR是數(shù)據(jù)寄存器
2.MAR的位數(shù)能夠體現(xiàn)最多存多少個(gè)地址，而每個(gè)地址就代表一個(gè)存儲(chǔ)單元，所以MAR的位數(shù)能表示存儲(chǔ)器中有多少個(gè)存儲(chǔ)單元
3.MDR是數(shù)據(jù)寄存器，它的容納極限 = 每個(gè)存儲(chǔ)單元的容納極限 --- 如果MDR的容納極限小于存儲(chǔ)單元的容納極限的話就會(huì)浪費(fèi)存儲(chǔ)空間，如果大于的話就會(huì)導(dǎo)致存儲(chǔ)單元存不下數(shù)據(jù)，造成數(shù)據(jù)溢出問(wèn)題?
4.MAR，MDR組合起來(lái)就是告訴我們要存那個(gè)存儲(chǔ)單元（地址），在里面存什么（數(shù)據(jù)）
1.n個(gè)二進(jìn)制位最多能表示的數(shù)有2的n次方個(gè)?
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1.大B表示的是字節(jié)Byte ， 小b表示的是比特bit --- 1Byte = 8bit
二.CPU的性能指標(biāo)
1.上圖中的每一個(gè)突起都是一個(gè)數(shù)字脈沖信號(hào)，而每出現(xiàn)一個(gè)數(shù)字脈沖信號(hào)，CPU就會(huì)指揮硬件進(jìn)行一次操作
3.一個(gè)突起和一個(gè)凹下連在一起就組成了一個(gè)CPU時(shí)鐘周期，CPU主頻與CPU時(shí)鐘周期成倒數(shù)關(guān)系，時(shí)鐘周期越小。
但是CPU的主頻越大，并不是說(shuō)Cpu的運(yùn)行速度越快
4.除了CPU主頻需要考慮之外，我們還需要考慮一個(gè)參數(shù) --- CPI：即執(zhí)行一條指令所需的時(shí)間周期數(shù) ---- CPI越小，CPU主頻越大，CPU的運(yùn)行速度越快
5.不同的指令它們之間的CPI可能不同，而在不同的CPU中執(zhí)行相同的指令，指令之間的CPI也可能不同；甚至在同一個(gè)CPU中，執(zhí)行同一條指令的CPI也可能不同。
因?yàn)橹噶畹膱?zhí)行不僅與CPU的狀態(tài)相關(guān)，還與其它的硬件的狀態(tài)有關(guān)，就比如取數(shù)這一條指令：
如果取數(shù)的時(shí)候存儲(chǔ)器的工作狀態(tài)為順暢的話則該指令的CPI就小，反之如果為繁忙的話該指令的CPI就會(huì)大
6.由于影響CPI的因素過(guò)多，所以我們一般都選取平均CPI來(lái)作為參考評(píng)判CPU的工作速度
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在描述運(yùn)行速度的時(shí)候使用上面的單位轉(zhuǎn)換 --- 如頻率，IPS，CPI...
在描述文件大小，存儲(chǔ)空間大小的時(shí)候，用下面的單位轉(zhuǎn)換
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三.系統(tǒng)整體的性能指標(biāo)?
1.硬件與硬件之間通過(guò)數(shù)據(jù)總線來(lái)傳遞數(shù)據(jù)
2.如果數(shù)據(jù)總線一次最多傳遞8bit的數(shù)據(jù)的話，則該數(shù)據(jù)總線的數(shù)據(jù)通路帶寬為8bit?
1.輸入一個(gè)請(qǐng)求到系統(tǒng)中，系統(tǒng)內(nèi)部處理完畢后輸出結(jié)果 --- 這樣一個(gè)過(guò)程可以稱為一個(gè)完整的請(qǐng)求，而系統(tǒng)一秒鐘內(nèi)能夠處理的完整的請(qǐng)求的個(gè)數(shù)就是 ----?該系統(tǒng)的吞吐量?
1.響應(yīng)時(shí)間可以理解為 --- 從一個(gè)請(qǐng)求輸入到系統(tǒng)輸出結(jié)果所需的時(shí)間
?1.最典型的動(dòng)態(tài)測(cè)試就是跑分軟件
1.顯然，處理一個(gè)乘法指令與處理多個(gè)加法指令相比，肯定是處理一個(gè)乘法指令更快
舉個(gè)例子：如果該基準(zhǔn)程序中的指令多為處理圖像的指令的話，GPU好的電腦得分肯定更高，但是如果指令多為進(jìn)行計(jì)算的指令的話，CPU好的電腦得分更高
一個(gè)電腦GPU好CPU差，一個(gè)電腦則是反過(guò)來(lái)，我們不能簡(jiǎn)單的說(shuō)兩個(gè)電腦誰(shuí)更好誰(shuí)更差，我們只能從特定的方向去比較?
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