【FPGA 約束：set_clock_groups 之異步時(shí)鐘】——詳細(xì)解析
FPGA 設(shè)計(jì)中，設(shè)置正確的時(shí)鐘約束是非常重要的。在設(shè)計(jì)中，不同的時(shí)鐘域之間都需要進(jìn)行一定的同步和互鎖，以保證系統(tǒng)能夠正常工作。而異步時(shí)鐘則是其中一個(gè)比較特殊的情況，其時(shí)序關(guān)系相對較為復(fù)雜，需要采用專門的約束方式來解決。本文將著重介紹 FPGA 約束中的 set_clock_groups 命令在異步時(shí)鐘約束中的應(yīng)用。
一、什么是異步時(shí)鐘？
異步信號是指在時(shí)鐘域之間沒有明確的時(shí)序關(guān)系，兩個(gè)信號之間既沒有同步也沒有互鎖的機(jī)制。在異步時(shí)鐘情況下，由于時(shí)序關(guān)系不確定，很容易產(chǎn)生一些奇怪的問題，例如互鎖、沖突、抖動等。因此，在異步時(shí)鐘情況下，必須采用專門的約束措施來限制其時(shí)序關(guān)系。
二、set_clock_groups 命令介紹
set_clock_groups 命令可用于設(shè)置時(shí)鐘組規(guī)則，指定哪些時(shí)鐘之間需要同步，哪些時(shí)鐘之間不需要同步。該命令可以方便地將時(shí)鐘域之間的時(shí)序關(guān)系進(jìn)行約束。
通常，對于不同的時(shí)鐘域，我們可以分別設(shè)置一個(gè)時(shí)鐘組，并將這些時(shí)鐘組之間的時(shí)序關(guān)系通過 set_clock_groups 命令進(jìn)行描述。
三、異步時(shí)鐘的約束方法
在異步時(shí)鐘情況下，由于時(shí)序關(guān)系不確定，需要采用特殊的約束方式。對于異步時(shí)鐘，我們可以將其劃分為兩個(gè)時(shí)鐘組：輸入時(shí)鐘組和輸出時(shí)鐘組。輸入時(shí)鐘組中包含異步時(shí)鐘信號，而輸出時(shí)鐘組中則包含需要與異步時(shí)鐘信號同步的時(shí)鐘信號。文章來源：http://www.zghlxwxcb.cn/news/detail-699791.html
set_clock_groups 命令的語法如下：文章來源地址http://www.zghlxwxcb.cn/news/detail-699791.html
set_clock_groups -asynchronous [-group input_clk_grp] [-group output_clk_grp]
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