【FPGA 衍生時(shí)鐘約束】——時(shí)鐘分頻與倍頻
在 FPGA 開發(fā)中，時(shí)鐘約束是必不可少的一部分。而對(duì)于一些需要高速運(yùn)算的設(shè)計(jì)，時(shí)鐘分頻和倍頻則是一種經(jīng)常使用的技術(shù)。在本文中，我們將詳細(xì)介紹 FPGA 中時(shí)鐘分頻和倍頻的實(shí)現(xiàn)方法及注意事項(xiàng)。
時(shí)鐘分頻：將時(shí)鐘信號(hào)分為更低頻率的信號(hào)
時(shí)鐘分頻是將時(shí)鐘信號(hào)分裂成更低頻率的信號(hào)，使得設(shè)計(jì)能夠通過(guò)較低的時(shí)鐘信號(hào)來(lái)進(jìn)行正常的運(yùn)算。在這里，我們以 100MHz 的時(shí)鐘信號(hào)為例，將其分裂為 50MHz 和 25MHz 兩個(gè)信號(hào)，在代碼中的實(shí)現(xiàn)方法如下：
// 100MHz 分頻為 50MHz
always @(posedge clk_100MHz)
if(cnt_1 == 0)
begin
cnt_1 <= 1;
clk_50MHz <= ~clk_50MHz;
end
else
cnt_1 <= cnt_1 + 1;
// 100MHz 分頻為 25MHz
always @(posedge clk_100MHz)
if(cnt_2 == 0)
begin
cnt_2 <= 1;
clk_25MHz <= ~clk_25MHz;
end
else
cnt_2 <= cnt_2 + 1;
注意：時(shí)鐘分頻后，需要重新進(jìn)行時(shí)序分析，并更新時(shí)鐘約束。文章來(lái)源：http://www.zghlxwxcb.cn/news/detail-740033.html
時(shí)鐘倍頻：將時(shí)鐘信號(hào)擴(kuò)大為更高頻率的信號(hào)
與時(shí)鐘分頻不同，時(shí)鐘倍頻是將較低頻率的時(shí)鐘信號(hào)擴(kuò)大成更高頻率的信號(hào)。在這里，我們以 50MHz 的時(shí)鐘信號(hào)為例文章來(lái)源地址http://www.zghlxwxcb.cn/news/detail-740033.html
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