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第10章 中斷控制單元簡介
本書使用的RA處理器R7FAM5系列使用的是ARM Cortex-M33內(nèi)核，其中斷機制是在Cortex-M33內(nèi)核的中斷機制基礎(chǔ)上進行的外設(shè)中斷擴展，因而RA處理器的中斷處理需要遵循Cortex-M33內(nèi)核的基本規(guī)則，包括但不限于中斷優(yōu)先級最高等級、中斷優(yōu)先級分類、中斷向量的分配等。
在RA處理器中，中斷控制歸于一個叫“Interrupt Controller Unit(中斷控制單元)”的模塊管理控制，簡稱ICU。
ICU模塊將異常向量中斷控制器（NVIC）、DMA控制器（DMAC）和數(shù)據(jù)傳輸控制器（DTC）的事件/中斷信號相互關(guān)聯(lián)，使得這些控制器之間的中斷信號可以互相傳輸利用。例如UART的數(shù)據(jù)發(fā)送關(guān)聯(lián)到DTC控制器，可以使UART的發(fā)送buff為空這個狀態(tài)去觸發(fā)DTC的傳輸完成中斷；又例如SPI的數(shù)據(jù)發(fā)送關(guān)聯(lián)到DMAC控制器，使SPI的發(fā)送buff為空這個狀態(tài)去觸發(fā)DMA的發(fā)送完成中斷，等等等等諸如此類。
ICU模塊的框圖如下圖所示：
將此框圖分為3大模塊：
① ICU控制的不可屏蔽中斷；
② ICU模塊的數(shù)據(jù)總線
③ ICU控制的可屏蔽中斷；
ICU模塊可以控制可屏蔽中斷和不可屏蔽中斷的具體細節(jié)如下表：
文章來源：http://www.zghlxwxcb.cn/news/detail-705686.html
在FSP中，表格里面的中斷都可以配置且可以和用戶自定義的中斷函數(shù)相關(guān)聯(lián)，本書不對本章進行獨立配置講解，將會從后文的實際外設(shè)驅(qū)動開發(fā)中來說明。文章來源地址http://www.zghlxwxcb.cn/news/detail-705686.html
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