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  Pspice是集成到Cadence的一個電路仿真工具，雖然說Multisim也很好用，但是cadence作為國內(nèi)市場占有率最高，國內(nèi)大多數(shù)公司都在用Cadence，學(xué)習(xí)使用Pspice進行電路仿真是非常有必要的。那么我們今天就仿真一個比較簡單的RC濾波電路。 那么如何安裝Cadence,對于習(xí)慣使用破解版的我們

  2024年02月22日

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  Allegro 16.6使用說明及技巧

  1.導(dǎo)入導(dǎo)出系統(tǒng)設(shè)計參數(shù) 導(dǎo)出：File→Expeort→parameters;全選（基本設(shè)置、光繪設(shè)置、色彩設(shè)置、文本尺寸、命令參數(shù)）→Export，選擇合適的目錄保存為.prm文件； 導(dǎo)入方法1：File→Import→parameters,加載之前保存的.prm文件，點擊import； 導(dǎo)入方法2：執(zhí)行 setup—user preferences 菜單操作

  2024年02月03日

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• Cadence 17.4 PSpice仿真555定時器輸出方波

  目錄 一、引言 二、555定時器組成多諧振蕩器原理圖 1、555定時器多諧振蕩器 ?2、OrCAD?PSpice 555定時器原理圖? 1) PSpice新建仿真項目 2) PSpice仿真器件選取 3）PSpice 555定時器產(chǎn)生方波原理圖

  2024年02月08日

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  allegro16.6-差分對走線

  1.差分線設(shè)置 logic-assign diffierential pair 2.差分規(guī)則設(shè)置 見《allegro-規(guī)則設(shè)置》 3.設(shè)置差分對單、雙根走線設(shè)置，點擊connect,選中走線，鼠標右擊一次選中sigle trace Mode，即可來回切換單雙跟走線

  2024年02月11日

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  allegro16.6系統(tǒng)gerber文件輸出規(guī)范詳解

  一、設(shè)計檢查 在 gerber 文件輸出之前必須要進行最后檢查！ 檢查項目： 1： update DRC，確保沒有斷短路 2：檢查 Summary drawing report，確保 5 個“0” 3：檢查 Dangling line and via report ,確保沒有冗余孔和線 4：進行絲印、 loop、 90 度、 solder2line 等自動工具檢查 ? 二、鉆孔文件輸出

  2024年02月06日

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  1.1 主要組件版本 組件 版本 kubernetes 1.16.6 etcd 3.4.3 containerd 1.3.3 runc 1.0.0-rc10 calico 3.12.0 coredns 1.6.6 dashboard v2.0.0-rc4 k8s-prometheus-adapter 0.5.0 prometheus-operator 0.35.0 prometheus 2.15.2 elasticsearch、kibana 7.2.0 cni-plugins 0.8.5 metrics-server 0.3.6 1.2 主要配置策略 kube-apiserver： 使用節(jié)點本地 nginx 4 層透

  2024年02月02日

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  2024年01月20日

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  蘋果iOS 16.6 RC發(fā)布：或為iPhone X/8系列養(yǎng)老版本

  今天蘋果向iPhone用戶推送了iOS 16.6 RC更新(內(nèi)部版本號：20G75)，這是時隔兩個月的首次更新。 按照慣例RC版基本不會有什么問題，會在最近一段時間內(nèi)直接變成正式版，向所有用戶推送。 需要注意的是，鑒于iOS 17正式版即將到來，后續(xù)iOS 16大概率不會帶來任何新功能的更新，只

  2024年02月16日

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  2024年02月04日

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  【Cadence使用】PCB元器件匹配3D模型

  Cadence支持制作及查看PCB板的3D模型。想要生成較逼真的PCB板模型，需要對PCB板上的每個元器件進行3D模型的匹配。 元器件模型下載 每個元器件需要對應(yīng)的3d模型進行匹配，我現(xiàn)在只嘗試了step格式的。如果自己不能手動設(shè)計模型，可以參考如下網(wǎng)址搜索下載模型。 元器件模型

  2024年02月05日

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