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????????《從底層結(jié)構(gòu)開始學(xué)習(xí)FPGA》目錄與傳送門
1、概述
????????鎖相環(huán) (phase-locked loop，PLL)，是一種控制反饋電路。PLL對時(shí)鐘網(wǎng)絡(luò)進(jìn)行系統(tǒng)級別的時(shí)鐘管理和偏移控制，具有時(shí)鐘倍頻、分頻、相位偏移和可編程占空比的功能。MMCM是混合模式時(shí)鐘管理器，相當(dāng)于能夠進(jìn)行精準(zhǔn)相移的PLL。（PLL為模擬電路，動態(tài)調(diào)相位數(shù)字電路）。
????????混合模式時(shí)鐘管理器 (mixed-mode clock manage，MMCM) 的官方解釋：This is a PLL with some small part of a DCM tacked on to do fine phase shifting (that’s why its mixed mode - the PLL is analog, but the phase shift is digital)。就是MMCM是在PLL的基礎(chǔ)上增加了相位動態(tài)調(diào)整功能，使得純模擬電路的PLL混合了數(shù)字電路設(shè)計(jì)，所以叫Mixed Mode。某種程度上，可以將PLL看做是MMCM的一個(gè)功能子集。
????????MMCM、PLL的功能可以總結(jié)為3點(diǎn)：文章來源：http://www.zghlxwxcb.cn/news/detail-460194.html
- 頻率綜合
- 去抖動
- 去偏斜
2、組成
????????在 7 系列 FPGA 中，每個(gè)時(shí)鐘管理塊 (CMT) 都包括一個(gè)MMCM和一個(gè)PLL。其大致框圖如下：文章來源地址http://www.zghlxwxcb.cn/news/detail-460194.html
到了這里，關(guān)于從底層結(jié)構(gòu)開始學(xué)習(xí)FPGA（15）----MMCM與PLL的文章就介紹完了。如果您還想了解更多內(nèi)容，請?jiān)谟疑辖撬阉鱐OY模板網(wǎng)以前的文章或繼續(xù)瀏覽下面的相關(guān)文章，希望大家以后多多支持TOY模板網(wǎng)！
